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ARCHITETTURA DEGLI ELABORATORI - Coggle Diagram
ARCHITETTURA DEGLI ELABORATORI
CPU
LIBRO
Istruzione
Linguaggio
ASSEMBLY
ISA=Instruction Set Architecture
TIPI DI ISTRUZIONI:
Istruzioni Aritmetiche
Istruzioni Logiche
Accesso alla memoria
istruzioni di Salto
Etichette
METODI DI INDIRIZZAMENTO
Indirizzamento INDIRETTO/IMMEDIATO
Indirizzamento ASSOLUTO
Indirizzamento a REGISTRO
Indirizzamento INDIRETTO A REGISTRO
Indirizzamento INDIRETTO A REGISTRO
CON SPIAZZAMENTO
OPCODE: Codice Operativo,
rappresenta il formato delle istruzioni da eseguire
Modello
INTEL 80X86
->Codici Binari
con istruzioni di lunghezza fissa e
lunghezza variabile
LC3
OPCODES:
Operate Instructions: ADD-AND-NOT
Data Movement Instructions: LD-LDI-LDR-LEA-ST-STR-STI
Control Instructions: BR-JSR-JSRR-JMP-RTI-TRAP
DATA TYPES
16 Bit in Complemento a 2
ADDRESSING
MODES
Immediate / Register
PC_Relative / Indirect / Base+Offset
ADD: 0001
LDR: 0110
JMP: 1100
NOT: 1001
AND: 0101
LD: 0010
ST: 0011
STR: 0111
LDI: 1010
STI: 1011
LEA: 1110
BR: 0000
GIOCATTOLO/TOY
Componenti: :
MAR
MDR
REGISTER FILE
PC
ALU
PSW
CU
IR
CPI=1
-->clock per istruzione
LA CPU ESEGUE LE ISTRUZIONI IN SEQUENZA, MA PRIMA DEL FETCH CONTROLLA LA PRESENZA DI
INTERRUPT
INTERRUPT
INTERRUPT SERVICE ROUTINE
POLLING
SERVICE DEVICE
INTERQ + INTERAK
MMIO=memory mapped i/o
FETCH
DECODE
EXEC
MEMORIA
Istruzioni
Dati
INTERRUPT
INTERRUPT SERVICE ROUTINE
POLLING
DEVICE SERVICE
INTERQ + INTERAK
MMIO=Memory Mapped I/O
DMA=Direct Memoy Access
COMUNICAZIONE
SU BUS
BUS SINCRONO
BUS ASINCRONO
DMA=Direct Memory Access
ARBITRAGGIO
MODELLO DI VON NEUMANN:
viene utilizzato per progettare architetture/sistemi di calcolo che si basano su un algoritmo.
Se, al contrario, è necessario basare un'architettura/sistema su una raccolta di dati, si utilizzano le RETI DI NEURALI; esse si configurano partendo dai dati in ingresso per produrre le uscite corrette (possono non essere precise, in questo caso si usa v.neumann).
CPU e MEMORIA comunicano tramite
un canale di comunicazione chiamato "BUS"