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エンベデッドスペシャリスト (ハードウェア (加算機・カウンタ・タイマ (半加算器, 並列加算器, ２進カウンタ, 10進カウンタ,…

- - - - NOT
      - AND
      - OR
      - XOR
      - 交換法則
      - 結合法則
      - 分配法則
      - ド・モルガンの法則
      - スリーステートバッファ
    - - ラッチ
      - フリップフロップ
  - - - 並列比較方式（フラッシュコンバータ）
      - 追従比較方式
      - 逐次比較方式
      - 二重積分方式
    - - 重み抵抗方式
      - 抵抗ラダー方式
      - デルタシグマ方式
      - PWM方式
    - - 反転増幅回路
      - 非反転増幅回路
      - 作動増幅回路
    - - リニア制御
      - PWM制御
  - - - ゲートアレイ
      - セルベースIC
      - エンベデッドアレイ
      - ストラクチャードASIC
    - - フルカスタム設計
      - ゲートレベル設計
      - RTL設計
      - ビヘイビアレベル設計
    - - PLD
      - CPLD
      - FPGA
  - - - 外部からのリフレッシュ操作不要
        
        SRAM
        
        議事SRAM
      - 外部からのリフレッシュ操作必要
        
        非同期型DRAM
        
        同期型DRAM
        
        SDRｰSDRAM
        
        DDR-SDRAM
    - - 書き込み不可
        
        マスクROM
      - 書き込み可
        
        消去不可
        
        ワンタイムPROM
        
        消去可
        
        紫外線消去
        
        UV-EEPROM
        
        電気的消去
        
        EEPROM
        
        フラッシュメモリ
        
        FeRAM
- - - - メモリマップドI/O方式
      - I/OマップドI/O方式
      - アドレスバス・データバスの共通化
  - - - SISD
      - SIMD
      - MISD
      - MIMD
    - - パイプライン制御
        
        フェッチ
        
        デコード
        
        ライトバック
        
        パイプラインバブル
        
        パイプラインハザード
        
        データハザード
        
        構造ハザード
        
        制御ハザード
      - スーパスカラ
        
        投機的実行
        
        リネームレジスタ
        
        分岐予測
        
        アウトオブオーダー実行
      - CISC
      - RISC
      - VLIW
      - マルチコア／メニーコア
        
        ホモジニアスマルチコア
        
        ヘテロジニアスマルチコア
      - コンフィギャラブルプロセッサ
    - - 積和演算気
      - 移動平均
      - 固定小数点型と不動小数点型
  - - - バスプロトコル
      - バススレーブ
      - バスマスタ
      - バスアービタ
    - - 単一バス構成
      - 階層バス構成
      - 複数バス構成
    - - 密結合構成
        
        共有メモリ方式
        
        デュアルポートメモリ
      - 疎結合構成
        
        分散メモリ方式